職位描述
Verilog HDLVHDL單片機軟硬件FPGA軟硬件電子/半導(dǎo)體/集成電路
崗位內(nèi)容：
1. 設(shè)計基于FPGA和單片機的數(shù)字信號處理電路原理。
2. 編寫Verilog HDL代碼，進行模擬仿真、綜合和布局布線。
3. 完成FPGA驗證測試，并發(fā)現(xiàn)并解決設(shè)計問題。
4. 實現(xiàn)FPGA設(shè)計規(guī)格書，包括架構(gòu)、設(shè)計、實現(xiàn)和驗證。
任職要求：
1. 精通數(shù)字電路設(shè)計和FPGA設(shè)計流程。
2. 具有豐富的HDL編程經(jīng)驗，熟練使用Verilog HDL語言。
3. 對數(shù)字信號處理和FPGA設(shè)計算法有深入了解。
4. 熟悉EDA工具鏈，如Vivado、Quartus等。
5. 有良好的溝通、團隊協(xié)作能力和問題解決技巧。
6. 本科及以上學(xué)歷，專業(yè)是電子、通信、計算機或相關(guān)領(lǐng)域。
職位福利：交通補助、餐補、五險一金、績效獎金、高溫補貼、通訊補助、不加班、全勤獎 職位亮點：雙休、節(jié)假日正常放。
獎金績效
完成公司安排的工作，成績突出，年底雙薪+獎金
工作地點
雁塔區(qū)西安亞鴻時代廣場亞鴻時代廣場A座1302～1304
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